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   課程目標(biāo)

        C6000 DSP硬件培訓(xùn)課程主要培養(yǎng)學(xué)生對DSP體系結(jié)構(gòu)的理解,掌握基于C6000的DSP芯片及高速板級高速電路硬件開發(fā)技術(shù),能夠開發(fā)自己的DSP系統(tǒng)。

   培養(yǎng)對象

        DSP系統(tǒng)的硬件開發(fā)工程師,電子類專業(yè)的大學(xué)生和研究生。

   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識:
        ◆了解數(shù)字信號處理原理;
        ◆有硬件電路設(shè)計基礎(chǔ);
        ◆有匯編語言和C語言基礎(chǔ)。

   師資團隊

徐老師

多年DSP開發(fā)經(jīng)驗,精通嵌入式Linux應(yīng)用開發(fā)、系統(tǒng)移植與驅(qū)動開發(fā),開發(fā)過基于達(dá)芬奇DSP6446的高清視頻會議系統(tǒng)、基于DM642的智能視頻監(jiān)控系統(tǒng)、基于DM642的IP遠(yuǎn)程、監(jiān)視器的同步監(jiān)控系統(tǒng),在基于DSP的DM642和6446芯片的視頻/圖像處理、視頻的壓縮算法等方面富有經(jīng)驗。

趙老師

精通TI公司的DM642芯片、達(dá)芬奇系列芯片的圖像/視頻處理,主持實施過大型人臉識別,指紋識別的項目,實戰(zhàn)經(jīng)驗豐富,長期從事教學(xué)與科研工作,主要研究方向包括網(wǎng)絡(luò)通信、視頻/圖像處理、數(shù)據(jù)庫等。具有16年以上的硬件設(shè)計經(jīng)驗,尤其是近十多年來一直從事高速DSP系統(tǒng)硬、軟件和FPGA開發(fā)經(jīng)驗數(shù)字電路設(shè)計工作,具有非常豐富的高速PCB設(shè)計經(jīng)驗。精通TI公司的C6000、ADI公司的TigerSHarc-201等系列高速DSP,成功開發(fā)了多個高速DSP和FPGA結(jié)合及DSP和ARM相結(jié)合的高難度項目,尤其擅長多處理器系統(tǒng)的開發(fā),精通多種圖像/視頻處理和相關(guān)的編碼解碼算法。

更多師資力量請見曙海師資團隊
   費用和課時
        ◆課時5天,64個學(xué)時
        團體報名優(yōu)惠措施:兩人95折優(yōu)惠,三人或三人以上9折優(yōu)惠 。注意:在讀學(xué)生憑學(xué)生證,即使一個人也優(yōu)惠500元。
        ◆
上課地點:華東師范大學(xué)/銀城大廈
       
   上課時間和地點
             上課地點:【上!浚和瑵髮W(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(中和大道) 【沈陽分部】:沈陽理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
             近開課時間(周末班/連續(xù)班/晚班):2025年6月9日....--即將開課--........................(歡迎您垂詢,視教育質(zhì)量為生命!)
   班級規(guī)模及環(huán)境--熱線:4008699035 手機:15921673576/13918613812( 微信同號)

        堅持小班授課,為保證培訓(xùn)效果,增加互動環(huán)節(jié),每期人數(shù)限3到5人。人手一機,全程實踐。

   質(zhì)量保障

        1、培訓(xùn)過程中,如有部分內(nèi)容理解不透或消化不好,可免費在下期培訓(xùn)班中重聽;
        2、課程完成后,授課老師留給學(xué)員手機和Email,保障培訓(xùn)效果,免費提供半年的技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。

   課程進度安排
課程大綱 課程內(nèi)容

第一階段

第1部分 DSP小系統(tǒng)設(shè)計

      1.1 小系統(tǒng)組成
      1.2 程序 ROM
      1.3 電源
      1.4 時鐘
      1.5 復(fù)位電路
      1.6 JTAG

第2部分 C6000的體系結(jié)構(gòu)

      2.1 C 6000 CPU 的結(jié)構(gòu)
      2.2 C 6000 基本指令系統(tǒng)
      2.3 C 6000 存儲器映射
      2.4 C 6000 外設(shè)概述

第3部分 C6000的外設(shè)

        3.1 EDMA
        3.2 中斷系統(tǒng)
        3.1 EMIF
        3.2 McBSP
        3.3 bootloader

實驗課: 用硬件設(shè)計軟件Allegro cadence軟件畫C6000系統(tǒng)小系統(tǒng)原理圖

      1 ) 熟系 Allegro cadence 軟件原理圖工具
      2 ) 理解 C6000 小系統(tǒng)組成原理
      3 ) 學(xué)習(xí)畫原理圖

第二階段

第4部分 高速電路設(shè)計理論基礎(chǔ)

      4.1 高速電路簡介
      4.2 傳輸線理論
      4.3 反射及端接技術(shù)
      4.4 串?dāng)_及其改善
      4.5 地彈及其改善

第5部分 電路板設(shè)計流程

      5.1 電路板設(shè)計流程的演變
      5.2 用 Allegro cadence 軟件設(shè)計電路板的流程
      5.3 信號仿真

實驗課:用Allegro cadence軟件畫C6000小系統(tǒng)的PCB

      1 ) 熟系 Allegro cadence 軟件 PCB 工具
      2 ) 學(xué)習(xí)畫 PCB
      3 )學(xué)習(xí)仿真
      4 ) 學(xué)習(xí)仿真

 
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.(2014年7月11)........................................................................................................
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