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計算機硬件系統(tǒng)設計培訓

1、課程導學與實驗環(huán)境

1.0 《計算機硬件系統(tǒng)設計》課程導學

1.1 一小時玩轉(zhuǎn)Logisim

1.2 Logisim中的延遲與險象

1.3 Logisim中的震蕩現(xiàn)象

1.4 Logisim常用組件庫【線路庫看看即可,其它用啥學啥】

1.5 Logisim新手實驗(★必做實驗★)

1.6 Logisim作品秀《五級流水CPU+操作系統(tǒng)+應用程序》

1.7 Educoder在線測試

實驗工具知識測試

2 數(shù)字邏輯基礎實驗 (數(shù)字邏輯)

2.1 組合邏輯電路設計

2.2 同步時序電路設計

2.3 小型數(shù)字系統(tǒng)設計

數(shù)字邏輯知識測試

3 數(shù)據(jù)表示實驗 (組成原理)

3.1 漢字編碼實驗

3.2 奇偶校驗應用實驗 RAID控制器(建設中)

3.3 海明編碼設計實驗

3.4 CRC編碼設計實驗

3.5 編碼流水傳輸實驗

數(shù)據(jù)表示單元測驗

4 運算器設計

4.1 運算器實驗基本框架

4.2 快速加法器實驗

4.3 32位ALU設計實驗

4.4 陣列乘法器以及乘法流水線設計

4.5 原碼一位乘法器設計

4.6 補碼一位乘法器設計

運算器單元測試

5 存儲系統(tǒng)設計

5.1 存儲系統(tǒng)實驗框架

5.2 漢字字庫存儲擴展實驗

5.3 MIPS RAM設計

5.4 MIPS寄存器文件設計

5.5 Cache映射機制與邏輯實現(xiàn)

5.6 硬件cache機制設計設計實驗

存儲系統(tǒng)單元測試

6 MIPS CPU設計

6.1 單周期MIPS架構(gòu)

6.2 多周期MIPS架構(gòu)

6.3 單周期MIPS CPU設計（8條指令）

6.4 多周期MIPS CPU微程序控制器設計

6.5 多周期MIPS CPU硬布線控制器設計

6.6 單周期MIPS CPU設計（24條指令）

6.7 MIPS中斷處理機制

CPU設計單元測試

7. MIPS指令流水線設計（系統(tǒng)結(jié)構(gòu)）

7.1 指令流水線基本概念

7.2 理想指令流水線設計

7.3 流水線分支相關處理

7.4 流水線數(shù)據(jù)相關處理

7.5 流水線高級調(diào)試技巧

7.6 流水線重定向處理

8.單總線MIPS CPU設計

8.1 單總線MIPS CPU數(shù)據(jù)通路

8.2 單總線MIPS CPU三級時序硬布線控制器原理

8.3 單總線MIPS CPU現(xiàn)代時序硬布線控制器原理

8.4 單總線MIPS CPU微程序控制器原理

8.5 單總線MIPS CPU三級時序控制器實驗

8.6 單總線MIPS CPU現(xiàn)代時序控制器實驗